超薄3D-IC封裝在製造過程和溫度循環測試耦合負載影響下的可靠性評估-深圳市福英達
超薄3D-IC封裝在製造過程和溫度循環測試耦合負載影響下的可靠性評估
為(wei) 應對物聯網和智能製造，基於(yu) 摩爾定律的半導體(ti) 芯片結構設計涉及相關(guan) 電子元器件尺寸的縮小。因此，晶體(ti) 管的密度逐漸增加。為(wei) 實現上述封裝要求，解決(jue) 傳(chuan) 統封裝框架的瓶頸，現有研究以堆疊方向的三維互連為(wei) 主流技術。關(guan) 鍵技術是矽通孔 (TSV) 和焊料微凸塊 (μbump) 的互連，這通常是失效位置方麵的關(guan) 注領域。三維集成電路（3D-IC）封裝在製造工藝和可靠性方麵的諸多挑戰需要克服，其中加速熱循環測試（TCT）的可靠性問題尤為(wei) 關(guan) 鍵。根據 JESD22-A104D 規範，封裝組件之間的劇烈熱膨脹係數(CTE) 不匹配會(hui) 在熱負載下對關(guan) 鍵焊料 μbump 產(chan) 生明顯的熱應力 。
圖 1. 實際超薄型芯片3D-IC封裝
Garofalo-Arrhenius蠕變模型
當材料在高於(yu) 熔點 0.5 T m的溫度下承受固定載荷時，應變隨時間增加。這種現象稱為(wei) 蠕變。圖 2表明，韌性材料在固定應力和溫度下的蠕變行為(wei) 可分為(wei) 三個(ge) 階段，即初級、二級和三級蠕變。穩態區占蠕變變形的大部分。對於(yu) 應用於(yu) 電子封裝的焊點，Garofalo-Arrhenius 模型，也稱為(wei) 雙曲正弦模型，被廣泛用於(yu) 定義(yi) 蠕變行為(wei) 。圖 2所示的第二階段呈現穩態蠕變，由 Garofalo-Arrhenius 模型描述。
圖2. 固定應力下焊料合金蠕變應變與(yu) 時間的關(guan) 係。
表1列出了本 FEA 中使用的詳細材料屬性。為(wei) 了準確預測 SnAg μbump 的蠕變行為(wei) 和封裝翹曲，我們(men) 將非線性材料屬性分配給焊料和銅 [ 34 ]。焊料表現出與(yu) 溫度相關(guan) 的特性和蠕變行為(wei) 。表 2列出了 SnAg 焊料的 Garofalo–Arrhenius 蠕變模型的係數。由於(yu) 熱循環負荷的最高溫度（125℃）超過成型材料的玻璃化轉變溫度（Tg）（110℃），成型材料的楊氏模量大大降低，從(cong) 而影響了成型材料的機械性能整個(ge) 包裹。因此，在目前的 FEA 中，應考慮 Tg 作為(wei) 成型材料。
表 1.當前 3D-IC 封裝 FEA 中使用的材料屬性列表。
表 2. 96.5Sn3.5Ag 焊料的 Garofalo–Arrhenius 模型參數 [ 32 ]。
由於(yu) 相關(guan) 組裝過程中的巨大溫度變化，往往會(hui) 在封裝結構內(nei) 誘發對可靠性產(chan) 生相當大影響的殘餘(yu) 應力。在這項研究中，通過闡明所提出的耦合載荷的問題和影響，預測了 TCT 之前封裝設備的實際機械狀態。 3D-IC封裝的超薄芯片製造工藝是將填充銅的 TSV 芯片粗磨至 100 μm，並調整其與(yu) 矽基板的連接。在 250 °C 的熱壓下，芯片和基板粘合在一起，形成 15 μm 的間隙，然後通過毛細管作用填充底部填充材料。此後，在芯片上塗上較厚的成型材料，以分散芯片的磨削載荷，從(cong) 而避免在將 100 μm 厚的芯片進一步磨削至 10 μm 厚度時發生芯片斷裂。然後將鈍化層沉積在組裝芯片的頂麵上。由於(yu) 相對於(yu) TCT 持續時間的時間限製，在製造過程的模擬中忽略了 μbumps 的蠕變行為(wei) 。本文采用的 TCT 條件遵循 JEDEC 標準 JESD22-A104 條件 D。溫度範圍介於(yu) −40 °C 和 125 °C 之間。從(cong) 25 °C 的室溫加熱到 125 °C 需要 450 秒。然後將 125 °C 的溫度保持 900 秒。溫度隨後在 900 秒內(nei) 從(cong) 125 °C 降至 -40 °C。最終，溫度在 450 秒內(nei) 恢複到 25°C。一次 TCT 持續 3600 秒。在這項工作中，在 FEA 中執行了七個(ge) 完整的 TCT，以獲得關(guan) 鍵焊料 μ 凸塊的收斂、增量和等效塑性和蠕變應變。
圖 5. 所提出的 3D-IC 封裝超薄芯片的製造工藝示意圖。
圖 6顯示了製造過程和 TCT 的耦合載荷影響的增量和等效塑性和蠕變應變。峰值應變出現在溫度恢複到室溫的過程的後期，因為(wei) 此時在封裝組件中引入了最顯著的CTE失配。以第 12 步的情況為(wei) 例，其中結構剛度因切屑變薄而降低。當封裝加熱到 200 °C 時，估計會(hui) 出現明顯的增量塑性應變峰值和等效塑性應變峰值。此外，分析結果表明，在七次 TCT 之後，μbumps 的增量和等效蠕變應變幾乎與(yu) 它們(men) 的增量和等效塑性應變相同。因此，在評估 TCT 的可靠性時，不能忽視 SnAg 焊料 μbumps 的蠕變效應。圖 7顯示了整個(ge) 封裝結構在每個(ge) 製造步驟和 TCT 中的翹曲變化。第 12 步的嚴(yan) 重翹曲可歸因於(yu) 臨(lin) 界變形的增加，該變形引起相應的增量和等效塑性應變。此外，TCT 相對於(yu) 製造部分引起的翹曲變化相當小。也就是說，在後續TCT的可靠性評估中需要考慮製造過程中殘餘(yu) 應力的影響。
圖 6.TCT的耦合載荷下，最外層焊料 μbumps 的估計等效塑性和蠕變應變增量的變化。
圖 7.基於(yu) 所提出的仿真方法的預測， 3D-IC 封裝的超薄芯片在處理步驟和後續TCT下的翹曲變化。
5.1.組裝芯片厚度
如圖8所示。隨著切屑厚度增加到大於(yu) ~20 μm，應變增量增加。這種現象隨著使用具有高楊氏模量的底部填充材料而變得廣泛。在 20 和 50 μm 之間的芯片厚度過渡處，芯片顯示出最小的結構彈性性。因此，影響 μbump 可靠性的主要機製是底部填充材料和 PBO 材料之間的 CTE 不匹配。然而，隨著采用剛性厚度層，填充銅的 TSV 與(yu) 芯片之間的熱失配會(hui) 增加。因此，在製造過程和 TCT 的負載下，μbumps 會(hui) 積累並維持較大的剪切應變。這種情況導致非彈性應變增加。相比之下，當具有低楊氏模量的底部填充物用作應力緩衝(chong) 層以分散μbump的剪切變形時，可以減少μbump的應變增量。
圖 8.考慮具有不同楊氏模量值的底部填充時，芯片厚度對臨(lin) 界 μbump 上等效非彈性應變增量的依賴性。
5.2.TSV間距效應
如圖 9所示當 TSV 間距從(cong) 170 μm 擴展到 250 μm 時，等效非彈性應變增量略有下降。原因可以歸因於(yu) 這樣一個(ge) 事實，即不同材料之間的 CTE 不匹配引起的應變可以均勻地分布到每個(ge) 焊料 μbump。然而，隨著應用各種底部填充物，觀察到應變幅度的顯著差異。結果表明，在保持相同間距的情況下，具有較低底部填充楊氏模量的 μbump 的應變增量會(hui) 減小。因此，設計的參數，即底部填充的楊氏模量，在減小 μbump 應變方麵比 TSV 間距更敏感。分析結果表明，具有 0.3 GPa 楊氏模量的底部填充是減少臨(lin) 界 μbump 應變累積的良好選擇。
圖9. 底部填充膠的四種不同楊氏模量被考慮時， TSV 間距對 μbump 非彈性應變增量的依賴性。
5.3.TSV半徑效應
對於(yu) TSV半徑的參數化分析，估計結果如圖10所示。與(yu) 之前關(guan) 於(yu) 其他參數的討論類似，當 TSV 的半徑尺寸固定時，底部填充膠的低楊氏模量會(hui) 導致 μbump 的應變增量較低。 TSV 半徑的增加通常會(hui) 導致較大的應變增量。盡管如此，具有 25 μm TSV 半徑和楊氏模量為(wei) 4 和 8.617 GPa 的底部填充的組裝芯片降低了 μbump 應變。因此，估計結果表明 TSV 半徑與(yu) μbump 的應變增量有關(guan) 。當 TSV 半徑從(cong) 10 μm 擴展到 25 μm 時，與(yu) PBO 材料的接觸麵積也會(hui) 擴大。由於(yu) 封裝組件之間的 CTE 不匹配導致的嚴(yan) 重變形會(hui) 增加 μbump 應變。除了凸點下冶金層(UBM)外，還包裹焊料 μbump 的底部填充物具有較低的楊氏模量，可提高結構的柔韌性。因此，可以大大降低上述應變。當 TSV 半徑為(wei) 25 μm 時，連接在焊料 μbump 上方的 UBM 層具有相同的直徑，並且 μbump 內(nei) 的應變也會(hui) 增加。使用楊氏模量為(wei) 4.0 或 8.617 GPa 的底部填充膠可以有效地抵抗 μbump 應變。因此，研究了 μbump 應變增量的下降。與(yu) 楊氏模量為(wei) 0.3 或 1 的底部填料的觀察結果相反，楊氏模量為(wei) 4.0 或 8.617 GPa 的底部填料抑製封裝翹曲的能力非常有限，盡管此時仍可以釋放 μbump 應變。因此，最終應變略有增加。
圖 10. 當考慮底部填充的幾個(ge) 楊氏模量時，TSV 半徑對 μbump 非彈性應變增量的依賴性。
結論
分析結果表明，由於(yu) 溫度相對於(yu) TCT溫度的劇烈變化，封裝結構在加工階段發生了嚴(yan) 重的翹曲。在 TCT 之前幾乎達到會(hui) 聚扭曲。此外，在製造過程中，塑性應變會(hui) 在焊料 μbump 內(nei) 大量累積。這種情況導致 TCT 期間塑料積累的減少。盡管如此，應考慮蠕變行為(wei) ，因為(wei) μbump 的蠕變應變通過 TCT 載荷達到其自身非彈性應變累積的一半。
關(guan) 於(yu) 參數分析，估計結果表明，相對較薄的芯片可以獲得良好的結構柔韌性，以釋放焊料 μbump 的應變。延長 TSV 間距也有利於(yu) 分散傳(chuan) 輸到 μbump 的 CTE 失配變形，從(cong) 而獲得低應變增量。至於(yu) TSV 半徑，發現較大的半徑會(hui) 導致填充銅的 TSV 和 PBO 層之間的接觸麵積增加。因此，臨(lin) 界 μbump 的應變增加主要是因為(wei) 封裝材料的嚴(yan) 重 CTE 變形。此外，選擇具有低楊氏模量的底部填充材料，被視為(wei) 一種應力緩衝(chong) 機製，是滿足焊料μbumps可靠性要求的好方法。
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參考文獻
Chang-Chun Lee, Yu-Min Lin, Hou-Chun Liu, Ji-Yuan Syu, Yuan-Cheng Huang & Tao-Chih Chang(2021). Reliability evaluation of ultra thin 3D-IC package under the coupling load effects of the manufacturing process and temperature cycling test. Microelectronic Engineering, vol. 244-266.
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